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전기·전자 > 반도체 설계용 S/W
회로판의 설계, 분석, 통합 과정의 효울적인 작업과 이에 대한 투자비용을 절감하기 위해서는 사전 시뮬레이션과 이에 적절한 툴을 사용하는 것이 필수적이라 하겠다. 본 회로 설계 시뮬레이션 소프트웨어 툴은 사용자에 특화된 통합 회로판 설계 툴(ASIC)과 사용자가 직접 프로그램밍이 가능한 Logic Field, 인쇄 회로판 (PCB), PCB-Prototype 장치로 이루어져 있으며. 제작된 회로판을(디지털, 아날로그) 평가할 수 있는 테스트 장치까지도 포함하고 있다. C++을 기본으로 한 모듈 라이브러리 알고리즘에 윈도우 환경을 기본으로 한 Graphic User Interface(GUI)를 지원한다.이 기술을 이용하면 Structure 디자인에서부터 시스템 드라이브까지 효율적인 회로판 설계가 가능하며, 작업 중에도 하드웨어에 종속적인 요소에 관한 monitoring 뿐 아니라, 설계자는 소프트웨어와의 인터액티브한 dialog가 가능함으로써 신속하게 피드백을 얻을 수 있다. 특히 윈도우 NT 핵심 Modus안에 time critically한 데이터 기록을 위한 각 구성요소 드라이브들도 쉽게 연결시킬 수 있으며 numeric 데이터의 신속한 데이터베이스 엑세스가 가능하다. 또한 Thin Layer 분석기와 같은 아주 복잡한 특수 계측 기기의 개발 설계나 시뮬레이션에도 응용이 가능하다.
- 보유기관
- 한국과학기술연구원
- 등록일
- 2004-07-07
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전기·전자 > 반도체 설계용 S/W
이 기술은 회로구조(Circuit structure)와 회로 레이아웃을 성공적으로 제조하기 위해 회로모델을 시뮬레이션 시스템으로, 각 회로 구성 요소들이 일으킬 수 있는 부작용의 효과(고주파 효과, High-frequency effects)들을 분석하여 회로 모델 안에 integrate 될 수 있는지의 여부를 파악하기 위한 기술이다. 이를 위해 이 기술은 Reduced-Order-Modelling 시스템을 기본으로 작업하는데, 이것은 같은 효과를 가지고 있으면서 회로 시뮬레이션 모델에 integrate 될 수 있는 회로 구조의 shorter list를 만들어 낼 수 있는 기술이다.이 회로 구조 시뮬레이션 시스템 기술의 가장 큰 특징은 cross-talk와 같은 고주파 효과 모델들을 사전에 추출해 낼 수 있으며, full description 보다 더 작고 쓸모 있게 설계 되어 있다는 점이다. 또한 이 모델들이 표준 시뮬레이션 소프트웨어의 Circuit design으로 integrated 될 경우 특수 시뮬레이션에 필요한 시간들을 줄일 수 있는 장점이 있다. 그리고 이 기술은 이미 표준 구조들과 비교, 테스트되어 그 정확성을 인정받은 바 있다.
- 보유기관
- 한국과학기술연구원
- 등록일
- 2005-06-27
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전기·전자 > 반도체 설계용 S/W
본 기술은 서로 운영체제가 틀리는 시스템상에서 다른 시스템을 동작시키기는 방법을 제시한다. 기존 운영체제는 별도의 입출력장치를 구비하여 사용하여야 하는 불편함이 있었다. 상기한 문제점을 해결하기 위한 본 발명은 씨디아이시스템에 의한 기능을 호스트시스템상에서 동작시키기 위한 인터페이스 회로를 제공한다. 또한 서로 다른 운용체제를 사용하는 시스템을 연결하는 인터페이싱회로를 사용하여 상호간의 데이터 전송이나, 입출력장치를 겸용할 수 있게 하였다. .본 기술은 서로 다른 운영체계를 사용하는 호스트시스템 및 CDI시스템과 호스트-데이터버스, 호스트-어드레스버스 및 CDI-데이터버스, CDI-어드레스버스로 연결된다. 상호간의 데이터를 인터페이스 하기 위한 인터페이스 회로를 호스트-어드레스버스로 인가한다.어드레스에 의해 내부에서 발생한 제1호스트 칩 선택신호 또는 상기 CDI시스템으로부터 제공되는 CDI 칩 선택신호를 통해 해독한다. 호스트시스템으로부터 제공되는 데이터 기록/독출신호 및 어드레스 기록/독출신호 또는 CDI시스템으로부터 제공되는 데이터 기록/독출신호에 의해 데이터를 기록하거나 독출하는 공통 메모리부를 가진다. 호스트-어드레스버스로 인가되는 어드레스에 의해 제2호스트 칩 선택신호를 발생한다. 제2호스트 칩 선택신호에 따라 상기 호스트-데이터버스로 인가되는 데이터를 래치하여 공통 메모리부에 등록된 데이터가 있음을 CDI시스템으로 알리기 위해 제1인터럽트신호를 발생한다. 제1인터럽트 발생부와, 상기 CDI시스템으로부터 인터럽트 요구신호가 인가될 시 제1인터럽트신호 발생 여부에 의해 상기 공통 메모리부에 등록된 데이터가 있음을 호스트시스템으로 알리기 위한 제2인터럽트신호를 발생한다.
- 보유기관
- (주)피앤아이비
- 등록일
- 2006-03-15
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전기·전자 > 반도체 설계용 S/W
본 발명은 설계된 디지탈 회로의 설계검증을 신속하고 정확하게 수행할 수 있는 입출력 탐침이 가능한 신속 프로토타이핑 시스템 및 그것의 탐침방법, 그리고 이를 이용한 효과적인 함수적 설계검증 방법과 이를 이용한 타이밍 과 함수적 혼합 검증 장치 및 이를 이용한 혼합 검증 방법에 관한 것이다.본 발명에서는 서버용 컴퓨터로 하여금 검증대상 디지탈 회로의 구현과 입출력 탐침을 가능하게 하는 탐침 부가회로를 위한 프로그래밍 패턴을 생성하게 함과 아울러 이 프로그래밍 패턴을 프로토타이핑 엔진의 각 RFPD에 다운로드되게 하여 설계검증 대상회로가 프로토타이핑 상에 구현되게 하고 부가된 입출력 탐침 부가회로를 통하여 입출력 탐침을 수행할 수 있게 한다. 또한 이와 같은 신속 프로토타이핑 장치를 논리시뮬레이터와 같이 사용한 혼합 검증 장치를 이용한 혼합 검증 방법으로 설계검증 대상회로에 대한 타이밍 검증 및 함수적 검증을 신속하면서도 정확하게 한다.본 발명에 따른 입출력 탐침이 가능한 신속 프로토타이핑장치 및 그 탐침 방법에서는 설계된 디지털 회로의 효율적이며 신속한 설계 검증을 위하여 회로상의 모든 신호선들, 또는 HDL 코드상의 모든 시그널들을 대상으로 빠르게 입출력 탐침할 수 있는 신속 프로토타이핑 장치 및 이를 이용한 자동화된 검증방법을 제공하는 이점이 있다. 또한 이와 같은 입출력 탐침을 가능하게 하는 신속 프로토타이핑 장치를 시뮬레이터와 같이 사용하여 고속의 함수적 검증 및 정확한 타이밍 검증을 가능하게 하는 타이밍 및 함수적 혼합 검증 장치 및 이를 이용한 자동화된 검증방법을 제공하는 이점이 있다.이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 실시예에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의하여 정하여져야만 한다.
- 보유기관
- 부산대학교
- 등록일
- 2006-05-10
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전기·전자 > 반도체 설계용 S/W
본 발명은 설계된 내장형 시스템의 하드웨어 및 소프트웨어의 동시 검증을 신속하고 용이하게 수행할 수 있는 내장형 시스템을 위한 신속 프로토타이핑 장치에 관한 것이다.본 발명에서의 내장형 시스템을 위한 신속 프로토타이핑 장치는 프로토타이핑 보드, 개인용 컴퓨터, 이 개인용 컴퓨터에서 운영되는 하드웨어/소프트웨어 동시 디버거 및 이 개인용 컴퓨터와 프로토타이핑 보드를 연결하는 통신용 연결장치로 구성된다. 프로토타이핑 보드의 구성은 내장형 시스템의 프로세서와 메모리 및 내장형 시스템의 디지털 하드웨어 부분을 구현할 수 있는 프로그래머블 소자와 외부와의 연결을 위한 연결기, 그리고 개인용 컴퓨터와 프로토타이핑 보드간의 통신을 위한 통신 인터페이스부로 구성되어 있다. 본 발명에 따른 복합 내장형 시스템을 위한 신속 프로토타이핑 장치에서는 프로토타이핑 보드 상에 프로그래머블 소자와 프로세서와 메모리 및 연결기를 장착하여 복합 내장형 시스템의 신속한 구현을 가능하게 하고, 구현된 복합 내장형 시스템에 대하여 프로그래머블 소자 상에 하드웨어적으로 구현된 사용자 하드웨어 부분과 프로세서와 메모리 상에 소프트웨어적으로 구현된 사용자 소프트웨어 부분을 개인용 컴퓨터 상에서 하드웨어/소프트웨어 동시 디버거를 이용하여 통합적인 동시 디버깅을 가능하게 한다.이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 실시 예에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의하여 정하여져야만 한다.
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- 부산대학교
- 등록일
- 2006-05-10
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전기·전자 > 반도체 설계용 S/W
본 발명은 설계된 디지탈 회로의 설계검증을 임의의 프로토타이핑보드와 임의의 시뮬레이터를 함께 이용하여 신속하면서도 정확하게 수행할 수 있는 에뮬레이션과 시뮬레이션의 혼합 검증 방법과 이를 위한 혼합 검증 장치에 관한 것이다.본 발명에서는 서버용 컴퓨터로 하여금 검증대상 디지탈 회로의 구현과 입출력 탐침을 가능하게 하는 탐침 부가회로를 위한 프로그래밍 패턴을 생성하게 함과 아울러 이 프로그래밍 패턴을 임의의 프로토타이핑 보드 상의 각 RFPD에 다운로드되게 하여 설계검증 대상회로가 임의의 프로토타이핑보드 상에 구현되게 하고 부가된 메모리소자 입출력 탐침 및 메모리 읽기/쓰기 부가회로를 이용하여 사용자 회로에 존재하는 모든 혹은 일부분의 메모리소자들에 대한 입출력 탐침과 메모리에 대한 읽기/쓰기를 혼합 검증 장치를 통하여 수행하게 함으로서 사용자 회로에 대한 검증을 위하여 에뮬레이션과 시뮬레이션을 자동적으로 번갈아 1번 이상 수행할 수 있게 한다. 본 발명에 따른 에뮬레이션과 시뮬레이션의 혼합 검증 장치 및 이를 이용한 혼합 검증 방법은 임의의 프로토타이핑 보드 상에 장착된 1이상의 RFPD들에 구현되어 에뮬레이션되는 설계검증 대상회로와 임의의 시뮬레이터에서 시뮬레이션되는 설계검증 대상회로간의 상태 정보 교환을 자동화된 방식으로 가능하게 함으로서 고속의 함수적 검증 및 정확한 타이밍 검증을 함께 번갈아 가면서 가능하게 하여 매우 효과적인 검증을 수행 할 수 있는 이점이 있다.이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 실시예에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의하여 정하여져야만 한다.
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- 부산대학교
- 등록일
- 2006-05-10
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전기·전자 > 반도체 설계용 S/W
본 발명은 설계된 디지탈 회로의 설계검증을 신속하고 정확하게 수행할 수 있는 신속 프로토타이핑 보드를 위한 입출력탐침방법 및 그것을 이용한 에뮬레이션/시뮬레이션 혼합검증 방법에 관한 것이다.본 발명에서는 서버용 컴퓨터로 하여금 검증대상 디지탈 회로의 구현과 입출력 탐침을 가능하게 하는 탐침 부가회로를위한 프로그래밍 패턴을 생성하게 함과 아울러 이 프로그래밍 패턴을 프로토타이핑 보드의 각 RFPD에 다운로드되게하여 설계검증 대상회로가 프로토타이핑 보드 상에 구현되게 하고 부가된 입출력 탐침 부가회로를 통하여 입출력 탐침을 수행할 수 있게 하고, 이것을 이용하며 에뮬레이션과 시뮬레이션을 1번 이상 번갈아 가면서 수행한다.본 발명에 따른 임의의 신속 프로토타이핑 보드나 임의의 PCB를 위한 입출력 탐침 방법 및 이를 이용한 혼합 검증 방법에서는 설계된 디지털 회로의 효율적이며 신속한 설계 검증을 위하여 회로상의 모든 신호선들, 또는 HDL 코드상의 모든 시그널들을 대상으로 빠르게 탐침함으로서 설계 오류를 신속히 디버깅할 수 있는 자동화된 검증방법을 제공하는 이점이 있다. 또한 이와 같은 입출력 탐침을 가능하게 하는 임의의 프로토타이핑 보드나 임의의 PCB를 시뮬레이터와 같이 사용하여 고속의 함수적 검증 및 정확한 타이밍 검증을 가능하게 하는 타이밍 및 함수적 검증방법을 제공하는 이점이 있다.이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 실시예에 기재된 내용으로 한정되는 것이 아니라 특허 청구의범위에 의하여 정하여져야만 한다.
- 보유기관
- 부산대학교
- 등록일
- 2006-05-10
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전기·전자 > 반도체 설계용 S/W
본 발명은 내장형 시스템의 효율적 디버깅을 가능하게 하는 신속 프로토타이핑 장치를 이용한 효과적인 디버깅 방법에관한 것이다.본 발명에서는 개인용 컴퓨터로 검증대상 내장형 시스템의 프로세서에 대한 이진 수행코드와 필요시 내장형 시스템의디지털 하드웨어 부분을 임의의 프로토타이핑 보드의 프로그래머블 소자에 구현하기 위한 프로그래밍 패턴까지를 생성하고, 이들 생성된 이진 수행코드와 프로그래밍 패턴을 개인용 컴퓨터 상의 디버거로 통신용 연결장치를 통하여 개인용컴퓨터로부터 임의의 프로토타이핑 보드 상의 메모리와 프로그래머블 소자에 각각 다운로드하게 하여 검증대상 내장형시스템이 임의의 프로토타이핑 보드상에 구현되게 한 후, 디버거를 이용하여 임의의 프로토타이핑 보드 상에 구현된 내장형 시스템의 실행을 완벽하게 제어하여 임의의 프로토타이핑 보드 상에 구현된 내장형 시스템의 상태를 자유롭게 변경해 가면서 검증함으로서 신속한 디버깅을 가능하게 한다.본 발명에 따른 내장형 시스템을 위한 신속 프로토타이핑 장치에서의 신속 디버깅 방법에서는 임의의 프로토타이핑 보드 상에 프로세서와 메모리 및 연결기, 그리고 필요시 프로그래머블 소자까지를 장착하여 내장형 시스템의 신속한 구현을 하고, 구현된 내장형 시스템에 대하여 디버깅을 수행하는 과정에서 멈춤점이나 관측점에서의 사용자 프로그램과 사용자 하드웨어의 실행 중지나 대기상태에서 신속 프로토타이핑 장치에 구현된 내장형 시스템의 현재의 완전 상태 정보를 읽어내어 개인용 컴퓨터에 저장하고 추후 쓰기 디버깅 명령어를 사용하여 이와 같은 상태를 신속 프로토타이핑 장치 상에 언제든지 재현할 수 있을 뿐만 아니라 필요시에 개인용 컴퓨터에서 수행되는 가상 프로토타입에 상기 완전 상태 정보를 전달하여 실제 프로토타입 보드에서 수행하는 것에 이어서 가상 프로토타입에서 내장형 시스템의 수행을 진행하는 것도 가능하며, 내장형 시스템의 디버깅 과정에서 특정 시점에서의 완전 상태 정보를 개인용컴퓨터에서 가상 프로토타입을 이용한 시뮬레이션 기반의 동시-검증 방법이나 기타 방법으로 새롭게 생성하여 이 또한쓰기 디버깅 명령어를 사용하여 신속 프로토타이핑 장치에 구현된 내장형 시스템의 상태 정보로 설정하여 수행을 가상프로토타입에서 수행하는 것에 이어서 실제 프로토타입 보드에서 하는 것이 가능하다. 이와 같은 신속 프로토타이핑 장치 상에 구현된 내장형 시스템의 상태를 자유자재로 설정할 수 있음으로 인하여 디버깅 시에 불필요하게 반복되어야 하는 내장형 시스템 수행 부분들을 생략하는 것이 가능할 뿐만 아니라 특정 부분만을 반복적으로 수행하는 것도 가능하여신속한 디버깅이 가능하게 할 뿐만 아니라, 물리적 프로토타입의 고속 수행 능력과 가상 프로토타입의 유연성 및 100%가시도(visibility)를 가능하게 하는 강력한 디버깅 능력 등을 동시에 달성할 수 있게 한다.
- 보유기관
- 부산대학교
- 등록일
- 2006-05-10
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일반기술
전기·전자 > 반도체 설계용 S/W
본 발명은 설계된 디지탈 회로의 설계검증 및 검사를 위한 효과적인 디버깅 방법을 가능하게 하는 신속한 입출력탐침장치 및 이를 이용한 입출력탐침 방법, 그리고 이를 기반으로 하는 네트워크 상에서의 에뮬레이션/시뮬레이션 분산 설계검증 및 검사 방법에 관한 것이다.본 발명에서는 임의의 서버용 컴퓨터에서 수행되어지는 본 발명의 입출력탐침 시스템소프트웨어로 하여금 설계검증 및검사 대상 회로에 입출력탐침을 가능하게 하는 탐침용 부가회로를 부가하여 입출력탐침이 가능한 확장된 회로를 자동화된 방식으로 생성하게 한다. 아울러 본 발명의 입출력탐침 인터페이스 모듈은 상기 입출력탐침이 가능한 확장된 회로가 하드웨어 칩으로 구현되어져서 있는 하드웨어 보드와 상기 서버용 컴퓨터를 연결시키고 상기 하드웨어 보드의 수행을 제어하면서 특정 시점이나 특정 조건에서 상기 하드웨어 보드 상의 상기 하드웨어 칩에 대한 입출력탐침을 수행하여상기 서버용 컴퓨터와 상기 하드웨어 칩간에 상기 설계검증 및 검사 대상 회로에 대한 수행결과 정보를 교환할 수 있도록 한다. 아울러 상기 서버용 컴퓨터와 네트워크로 연결되어진 상기 설계검증 및 검사 대상 회로를 시뮬레이션하는 임의의 시뮬레이션 서버용 컴퓨터와 같이 분산된 환경 하에서 에뮬레이션과 시뮬레이션을 1차례이상 자동적인 방법으로번갈아 가면서 수행하게 한다.본 발명에 따른 입출력탐침 장치 및 이를 이용한 입출력 탐침 방법은 임의의 프로토타이핑 보드나 임의의 PCB 상에 장착된 1이상의 반도체 칩들에 구현되어 에뮬레이션되는 설계검증 대상회로에 대하여 100％ 신호가시도를 갖고 신속하며 효과적인 디버깅을 가능하게 함과 더불어 임의의 시뮬레이터에서 시뮬레이션되는 설계검증 대상회로와의 상태정보 교환을 완전 자동화된 방식으로 가능하게 함으로서 고속의 함수적 검증 및 정확한 타이밍 검증을 함께번갈아 가면서 가능하게 하여 매우 효과적인 검증을 수행 할 수 있는 이점이 있다. 이와 같은 이점은 ICE 환경에서도완벽하게 지원되고, RFPD 내부의 칩상 메모리를 사용하는 경우에도 완벽하게 지원되는 이점이 있다.이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 실시예에 기재된 내용으로 한정되는 것이 아니라 특허 청구의범위에 의하여 정하여져야만 한다.
- 보유기관
- 부산대학교
- 등록일
- 2006-05-10
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일반기술
전기·전자 > 반도체 설계용 S/W
본 발명은 설계된 수백만 게이트급 이상의 디지탈 회로의 설계검증 및 검사를 위한 효과적인 디버깅 방법에 관한 것이다.본 발명에서는 임의의 서버용 컴퓨터에서 수행되어지는 본 발명의 입출력탐침 시스템소프트웨어로 하여금 설계검증 및검사 대상 회로에 입출력 탐침을 가능하게 하는 탐침용 부가회로를 부가하여 입출력탐침이 가능한 확장된 회로를 자동화된 방식으로 생성하게 한다. 아울러 본 발명의 입출력탐침 인터페이스 모듈은 상기 입출력탐침이 가능한 확장된 회로가 하드웨어 칩으로 구현되어져서 있는 하드웨어 보드와 상기 서버용 컴퓨터를 연결시키고 상기 하드웨어 보드의 수행을 제어하면서 특정 시점이나 특정 조건에서 상기 하드웨어 보드 상의 상기 하드웨어 칩에 대한 입출력탐침을 수행하여상기 서버용 컴퓨터와 상기 하드웨어 칩간에 상기 설계검증 및 검사 대상 전체 회로나 부분적인 회로에 대한 수행결과정보를 빠르게 교환할 수 있도록 한다. 아울러 상기 서버용 컴퓨터와 상기 설계검증 및 검사 대상 전체 회로 혹은 부분회로만을 시뮬레이션하는 임의의 시뮬레이션 서버용 컴퓨터를 이용하여 에뮬레이션과 시뮬레이션을 1차례이상 자동적인 방법으로 빠르게 번갈아 가면서 수행하게 하여 매우 효과적인 디버깅을 가능하게 한다.본 발명에 따른 디버깅 장치 및 이를 이용한 디버깅 방법은 본 발명의 목적은 초대규모급 설계 검증을 위한 하드웨어적으로 구현된 대규모 디지털 시스템의 에뮬레이션과 시뮬레이션을 혼용하는 설계검증에서 설계검증대상회로의 규모가 시뮬레이션의 한계를 넘어가는 경우에도 상기 에뮬레이션과 시뮬레이션을 혼용한 설계검증 방법을적용 가능하게 하는 디버깅 장치 및 이를 이용한 매우 효율적이며 강력한 디버깅 방법을 제공하게 된다. 뿐만 아니라,인-서킷 환경 에서 상기 에뮬레이션과 시뮬레이션을 혼용하기 위하여 시뮬레이션 과정에서 필요한 주변 타겟 하드웨어환경의 모델링을 자동화된 방법으로 신속·정확하게 제공하게 된다.이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 실시예에 기재된 내용으로 한정되는 것이 아니라 특허 청구의범위에 의하여 정하여져야만 한다.
- 보유기관
- 부산대학교
- 등록일
- 2006-05-10
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일반기술
전기·전자 > 반도체 설계용 S/W
본 발명은 설계된 수백만 게이트급 이상의 디지탈 회로의 설계 검증을 위한 설계 검증 장치 및 이를 이용한 설계 검증방법에 관한 것이다.본 발명에서는 임의의 서버용 컴퓨터에서 수행되어지는 본 발명의 설계검증 시스템소프트웨어로 하여금 설계검증 대상회로에 입력/출력/입출력 탐침을 가능하게 하는 탐침용 부가회로를 부가하여 입력/출력/입출력탐침이 가능한 확장된 회로를 자동화된 방식으로 생성하게 한다. 아울러 본 발명의 설계검증 인터페이스 모듈은 상기 입력/출력/입출력탐침이가능한 확장된 회로가 1이상의 프로그래밍가능 소자로 구현되어 여타 다른 하드웨어 컴포넌트들과 함께 장착되어 있는하드웨어 보드와 상기 서버용 컴퓨터를 연결시키고 상기 하드웨어 보드의 수행을 제어하면서 특정 시점이나 특정 조건에서 상기 하드웨어 보드 상의 상기 1이상의 프로그래밍가능 소자에 대한 입력/출력/입출력탐침을 수행하여 상기 서버용 컴퓨터와 상기 1이상의 프로그래밍가능 소자에 상기 설계검증 대상 전체 회로나 부분적인 회로에 대한 수행결과 정보를 빠르게 교환할 수 있도록 한다. 아울러 상기 서버용 컴퓨터와 상기 설계검증 대상 전체 회로 혹은 부분 회로만을시뮬레이션하는 임의의 시뮬레이션 서버용 컴퓨터를 이용하여 에뮬레이션과 시뮬레이션을 1차례이상 자동적인 방법으로 빠르게 번갈아 가면서 수행하여 점진적 설계 검증을 통하여 설계 검증 대상회로에 존재하는 1이상의 설계 오류를 신속하게 제거하는 것을 가능하게 한다.본 발명에 따른 설계 검증 장치 및 이를 이용한 설계 검증 방법의 목적은 초대규모급 설계 검증을 위한 하드웨어 적으로 구현된 대규모 디지털 시스템의 에뮬레이션과 시뮬레이션을 혼용하는 설계검증을 수행하여 설계검증 대상회로의 규모가 시뮬레이션의 한계를 넘어가는 경우에도 상기 에뮬레이션과 시뮬레이션을 혼용한 설계검증 방법을 적용하여 신속하게 설계검증을 가능하도록 한다. 구체적으로는, 설계 오류들을 신속하게 발견하도록 하는 것을 가능하게 할뿐만 아니라, 이들 발견된 설계 오류들을 신속하게 수정하도록 하는 것도 가능하다.이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 실시예에 기재된 내용으로 한정되는 것이 아니라 특허 청구의범위에 의하여 정하여져야만 한다.
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- 부산대학교
- 등록일
- 2006-05-10
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일반기술
전기·전자 > 반도체 설계용 S/W
본 발명은 설계된 수백만 게이트급 이상의 디지탈 회로의 설계 검증을 위한 설계 검증 장치 및 이를 이용한 설계 검증방법에 관한 것이다.본 발명에서는 임의의 서버용 컴퓨터에서 수행되어지는 본 발명의 설계검증 시스템소프트웨어로 하여금 설계검증 대상회로에 입력/출력/입출력 탐침을 가능하게 하는 탐침용 부가회로를 부가하여 입력/출력/입출력탐침이 가능한 확장된 회로를 자동화된 방식으로 생성하게 한다. 또한 필요 시에는 검사 혹은 모니터 모듈도 함께 부가한 회로를 자동화된 방식으로 생성하게 하여 하드웨어 기반에서 ABV-기반의 검증도 가능하게 한다. 아울러 본 발명의 설계검증 인터페이스 모듈은 상기 입력/출력/입출력탐침이 가능한 확장된 회로가 1이상의 프로그래밍가능 소자로 구현되어 여타 다른 하드웨어 컴포넌트들과 함께 장착되어 있는 하드웨어 보드와 상기 서버용 컴퓨터를 연결시키고 상기 하드웨어 보드의 수행을제어하면서 특정 시점이나 특정 조건에서 상기 하드웨어 보드 상의 상기 1이상의 프로그래밍가능 소자에 대한 입력/출력/입출력탐침을 수행하여 상기 서버용 컴퓨터와 상기 1이상의 프로그래밍가능 소자에 상기 설계검증 대상 전체 회로나 부분적인 회로에 대한 수행결과 정보를 빠르게 교환할 수 있도록 한다. 아울러 상기 서버용 컴퓨터와 상기 설계검증대상 전체 회로 혹은 부분 회로만을 시뮬레이션하는 임의의 1 이상의 시뮬레이션 컴퓨터들을 이용하여 에뮬레이션과시뮬레이션을 1차례이상 자동적인 방법으로 빠르게 번갈아 가면서 수행하여 설계 검증을 통하여 설계 검증 대상회로에존재하는 1이상의 설계 오류를 신속하게 제거하는 것을 가능하게 한다.본 발명에 따른 설계 검증 장치 및 이를 이용한 설계 검증 방법의 목적은 초대규모급 설계 검증을 위한 하드웨어 적으로 구현된 대규모 디지털 시스템의 에뮬레이션과 시뮬레이션, 그리고 정식검증을 혼용하는 설계검증을수행하여 설계검증 대상회로의 규모가 시뮬레이션의 한계를 넘어가는 경우에도 상기 에뮬레이션과 시뮬레이션과 정식검증을 혼용한 설계검증 방법을 적용하여 신속하게 설계검증을 가능하도록 한다. 구체적으로는, 설계 오류들을 신속하게 발견하도록 하는 것을 가능하게 할뿐만 아니라, 이들 발견된 설계 오류들을 신속하게 수정하도록 하는 것도 가능하다.이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 실시예에 기재된 내용으로 한정되는 것이 아니라 특허 청구의범위에 의하여 정하여져야만 한다.
- 보유기관
- 부산대학교
- 등록일
- 2006-05-10
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전기·전자 > 반도체 설계용 S/W
본 발명은 설계된 매우 복잡한 디지탈 시스템의 설계 검증을 위한 검증 장치와 이를 이용한 효과적인 시뮬레이션 방법에관한 것이다.본 발명에서는 임의의 컴퓨터에서 수행되어지는 본 발명의 검증 소프트웨어로 하여금 설계 코드에 부가적인 코드를 부가하여 시뮬레이션을 수행하게 한다. 시뮬레이션 수행은 1차 시뮬레이션과 2차 시뮬레이션으로 나누어지며 2차 시뮬레이션은 1 이상의 컴퓨터에서 수행되는 1 회 이상의 시뮬레이션을 1 이상의 시뮬레이터를 이용하여 병렬적인 수행을 가능하게함으로서 전체 검증 시간의 대폭적인 단축을 가능하게 한다.본 발명에 따른 검증 장치 및 이를 이용한 설계 검증 방법의 목적은 초대규모급 설계 검증을 위하여 시뮬레이션을 수행하는 경우에 1차 시뮬레이션을 통해서 1차 이후에 추가적으로 진행될 시뮬레이션들을 매우 빠르고 효과적으로 진행하는 것에 필요한 최소한의 정보들을 수집하고, 이 후에 진행되는 추가적인 시뮬레이션들을 하나의 시뮬레이터를 이용하여 순차적으로, 내지는 2 이상의 시뮬레이터를 이용하여 병렬적으로 빠르게 진행하게 함으로서 전체의 시뮬레이션 시간을 단축하며, 빠른 시간 내에 설계 코드에 존재하는 오류들의 위치를 정확히 찾아내어 수정하는 것이 가능하다.이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 실시 예에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의하여 정하여져야만 한다.
- 보유기관
- 부산대학교
- 등록일
- 2006-05-10
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전기·전자 > 반도체 설계용 S/W
본 발명은 연소시스템에서 대기로 방출되는 유해 가스의 농도를 광 계측함에 있어 빠른 응답성과 고 정밀 계측이 가능한 파장 변조 분광기법 및 광섬유를 이용한 반도체 다이오드 레이저 광 계측 시스템에 관한 것으로, 임의 파형 발생기를 이용하여 생성된 특정 주파수와 크기를 가지는 합성파를 반도체 다이오드 레이저 구동장치의 전류 연결부에 주입하여 레이저소오스에 걸어주고, 수광부에서 흡수 영역을 통과한 투과 신호에서 조화 신호를 추출함으로써 잡음이 제거된 높은 감도의 신호값을 얻을 수 있을 뿐만 아니라 대상 가스의 농도를 정밀하게 계측할 수 있다. 그리고, 대기 중으로 광을 조사하는 기존의 복잡한 계측 방식과 달리 대상 가스의 흡수 파장에 부합하는 광섬유 부품과 라인을 통하여 계측 시스템을 간단히 구성할 수 있을 뿐만 아니라 연소 장치나 실험 장치에 효과적으로 적용할 수 있는 장점을 가지고 있다.이 시스템의 구성에 따르면 본 발명은 질소 산화물과 같은 각종 유해 배기 물질을 실시간으로 모니터링함에 따라 최적의 연소 조건으로 연소 시스템을 조절할 수 있기 때문에 현재 배출되는 유해 가스를 촉매 장치와 같은 부가적인 장치 없이 효과적으로 저감시킬 수 있어 원가 절감 및 환경적 효과를 거둘 수 있다.또한, 기존의 레이저 계측기에 비해 유지, 보수가 용이하므로 인력 절감의 간접적인 경제 효과를 볼 수가 있으며, 파장을 가변화할 수 있기 때문에 질소 산화물 및 일산화탄소 등에 국한되지 않고 CO2 등과 같은 연소 생성물과 OH, C2F6 , CF4등과 같은 기존의 계측기로는 불가능한 중간 생성물 및 특정 유해 물질의 계측까지 가능하다.뿐만 아니라 계측 Parameter를 단순 농도 계측만 하는 것이 아니라 온도, 밀도, 유체의 속도 등과 같은 여러 변수를 계측할 수 있어 이 시스템을 광범위하게 적용할 수 있다.*기술성임의 파형 발생기를 이용하여 생성된 특정 주파수와 크기를 가지는 합성파를 반도체 다이오드 레이저 구동장치의 전류 연결부에 주입하여 레이저 소오스에 걸어주고, 수광부에서 흡수 영역을 통과한 투과 신호에서 조화 신호를 추출하는 기술을 정확히 파악하고 있고, 본 기술과 관련된 일부 기술을 보유 및 적용한 사례가 있어 국내개발업체들과 비교하여 기술적 우위를 점하고 있는 것으로 판단됨*시장성- 대기로 방출되는 유해 가스의 농도를 광으로 계측하기 위한 광계측 분야의 수요는 대기 오염 문제를 해결하기위해 향후 급속히 성장할 것이라고 예측되고 있음- 이러한, 제품의 신뢰성을 높이는 핵심 장치에 해당하는 임의파형 발생기, 서미스터, 열-전기 냉각기로 인하여레이저 소오스로부터 안정한 파장의 빔을 확보하여 향후 관련 기술이 개발되는 경우에는 효과적으로 시장에 진입할 가능성이 높을 것으로 판단됨- 향후 충분한 수요처의 확보는 가능할 것으로 보이며, 수입대체 효과와 수출 제품에 장착될 가능성이 높을 것으로 전망됨
- 보유기관
- 한국생산기술연구원
- 등록일
- 2006-05-22
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