일반기술
전기·전자 > 집적회로설계 기술 (B63)
본 발명은 구동전압 및 광손실을 줄이기 위한 전기광학 폴리머 광도파로 소자의 구조를 제공한다. 본 발명은 광도파로 소자의 입출력부에 모드 크기가 광섬유 모드와 같은 수동형 광도파로를 만들고 이를 수직방향 테이퍼를 두께가 이용하여 얇은 코아를 가지는 전기광학 광도파로와 연결시킨다. 이러한 구조를 이용하면 입출력부의 모드 부정합 손실을 무시할수 있을 정도로 작게하고 전기광학 광도파로의 길이를 실질적인 변조기 길이로 국한시켜서 도파광의 전파 손실도 줄이므로 종래의 광도파로 소자 보다 낮은 삽입 손실을 갖는 전기광학 폴리머 광도파로 소자를 구현할 수 있다. 또한 전기광학 광도파로의 두께를 충분히 얇게 만들어서 전기광학 변조효율을 극대화 시키고 구동전압을 매우 낮게 할 수 있는 구조를 제공한다.청구범위: 전기광학 폴리머 광도파로 소자의 구동전압과 삽입 손실을 줄이기 위한 구조에 있어서, 광도파로의 입출력부 영역의 수동형 광도파로와 광변조부 영역의 광도파로 사이에 수직방향 테이퍼 광도파로를 형성하고, 상기 입출력부 광도파로의 도파모드의 크기를 광섬유와 동일한 크기로 만든 수동형 광도파로를 형성하여 광섬유와의 연결손실을 최소화한 광도파로 소자의 구조.
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- 한국전자통신연구원
- 등록일
- 2002-07-09
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전기·전자 > 집적회로설계 기술 (B63)
이 기술은 보통의 bipolar 트랜지스터의 잇점을 가지고 전기적인 특성에 있어서는 자기장에 의존하는 성질을 가진 스핀 트랜지스터에 관한 기술이다. 스핀 트랜지스터는 종래의 반도체 트랜지스터 같이 전기적인 전하의 상태에 의한 동작보다 자기 스핀 모멘트에 의해 동작하는 트랜지스터이다. 스핀 트랜지스터는 자동차, 로보트 공학, 기계공학과 데이터 저장을 위한 고민감성 자기장 센서의 안정된 결합을 할 수 있는 큰 잠재력을 가지고 있다. 이것들은 자기적으로 제어되는 모수적(parametric) 증폭기와 혼합기로서 쓰여지기도 한다. 이 장치는 자기신호 프로세스로서 brushless DC motors 를 위한 것이다. 그리고 자기 논리 소자로도 쓰인다. 논리소자로서의 응용에 있어서 이것은 종래의 반도체 칩보다 많은 잇점이 있는데 그 중 저장 상태를 유지하기 위해 전력을 쓸 필요가 없는 것이 가장 큰 장점이다. 이러한 디바이스는 자동차 분야에서 전기센서시장에서 가장 빠른 성장세를 보이고 있다. 이러한 성장세를 보이는 이유는 자동차의 배기가스를 줄이고 브레이크나 anti-skid systems 의 안전성을 확보하기 위한 내부연소엔진 관리에 대한 수요가 늘어나기 때문이다. 지기 센서의 가장 첫번째 약진은 1988년의 거대자기저항(GMR)현상의 발견이었다. 이것은 개선된 자기장에 대한 저항 민감성을 가진 스핀 트랜지스터를 낳았다. 이러한 3개의 터미널 디바이스는 터미널들 중에 두개를 가로지르는 자기장의 응용에 있어서 3번째 터미널의 전류를 제어한다. 그러나 초기에는 스핀 트랜지스터가 그리 유용성이 없었는데 그 이유는 unity 보다 큰 gain을 얻기가 불가능했기 때문이다. 그러나 이 기술에서는 스핀트랜지스터의 이러한 특성을 개선시켰다. 이 기술은 하이브리드 반도체/금속 기술을 사용한 unity 보다 gain이 큰 성질이 개조된 스핀 트랜지스터이다. 이것은 스핀 트랜지스터의 성능을 현저하게 강화하였고 센서 기술 개발에 있어서의 가치도 강화시킬 것이다.전원이 없어도 메모리 상태를 유지한다.unity 보다 gain이 더 크다. 기존의 스핀 트랜지스터보다 현저하게 성능이 향상되었다.
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- 대일기업평가원
- 등록일
- 2003-01-27
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
본 발명은 MMIC(Monolithic Microwave Integrated Circuits)이나 RFIC(Radio Frequency IC) 등의 기술로 구현된 칩(chip) 형태의 전압제어 발진기(VCO: Voltage Controlled Oscillator)가 지니고 있는 낮은 위상잡음 특성을 획기적으로 개선시킬 수 있는 집적 회로형 초소형 전압제어 발진소자의 위상잡음 개선방법에 대한 것이다. 이동통신기술이 급속히 발전함에 따라 사용자의 이동성 및 휴대성 보장을 위한 사용 단말의 크기 및 무게가 줄어들고 있으며, 사용되는 부품들의 경박단소화(輕薄短小化)가 급속히 이루어지고 있다. 전압제어발진기는 송수신기의 채널을 설정해주는 주파수 합성기의 주요 부분으로 발진신호의 출력레벨, 위상잡음, 고조파특성 등이 시스템 감도 및 동작특성을 직접적으로 결정하는 RF 핵심부품이라 할 수 있으며, 크기 및 특성개선에 대한 연구가 꾸준히 이루어져 왔다. 이동통신기기용 전압제어발진기는 90년대 이전까지는 발진에 필요한 공진소자로서 유전체 공진부가 주로 사용되었으나, 소형화 추세에 따라 다층 PCB 구조 내에 공진소자를 실장한 콜피츠(Colpitts) 방식이 주로 사용되고 있다. 회로 구성 측면에서는 1 개의 바이폴라 트랜지스터를 이용한 단일 발진부 구조를 사용하거나 출력 및 특성 안정화를 위한별도의 완충 증폭기를 캐스코드(cascode) 형태로 적용시킨 2단 발진부가 주로 사용되고 있다.본 발명은 FR4 또는 에폭시(epoxy)PCB인 일반 PCB나 세라믹 PCB로 구성되어 회로소자 및/또는 회로패턴을 탑재하기 위한 1층(Layer) 이상의 다층구조로 되어있는 기판(Substrate)과, SMT(Surface Mounting Technology,표면실장) 형태 또는 COB (Chip-On-Board)의 형태로 상기기판 위에 부착된 발진부(Oscillating Part), 발진주파수 조정을 위한 바랙터 다이오드(Varactor Diode)와 잡음 제거를 위한 쵸크필터(Choke filter)용 마이크로스트립 라인으로 구성되는 주파수 제어부, 공진주파수 및 위상잡음을 결정하여주는 마이크로스트립 라인(Microstrip Line)으로 구성된 공진부로 이루어져 있다. 본 발명에 의하면, 기존의 집적 회로형 전압제어발진기가 지니고 있는 낮은 위상잡음 특성을 크게 개선시킬 수 있고 외부 마이크로스트립 라인을 레이저 트리밍 (Laser Trimming)함으로써 발진주파수를 변경시킬 수 있는 장점을 얻을 수 있으며, 칩(chip) 내에 실장하기 어려운 부품들을 외부에서 구현할 수 있으므로 칩 제조단가 등을 줄일 수 있다. 또한 기존의 R,L, C 등의 집중정수(Lumped Element) 회로소자로 구성된 전압제어 발진기와 동일한 위상잡음 특성을 지니면서도 고집적도의 제품구성이 가능하게 되어 제조가격을 절감하고 제품의 크기, 무게 및 부피를 크게 줄일 수 있다.기존의 집적회로형 전압제어발진기가 지니고 있는 낮은 위상잡음 특성을 크게 개선.발진주파수를 변경시킬 수 있음.칩 제조단가 절감.기존의 R,L, C 등의 집중정수(Lumped Element) 회로소자로 구성된 전압제어 발진기와 동일한 위상잡음 특성을 지니면서도 고집적도의 제품구성이 가능하게 되어 제조가격 절감.제품의 크기, 무게 및 부피 감소효과.
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- 대일기업평가원
- 등록일
- 2003-01-27
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전기·전자 > 집적회로설계 기술 (B63)
동 프로젝트는 일종 신형의 infrared 쾌속가열 고 진공게르마늄 실리콘 화학기상 외연시스템(RHTHR/CVD) 시스템이다. 게르마늄 실리콘, 실리콘 heterojunction는 에너지 밴드 공정기술을 이용한 차세대 실리콘 소재로서 그의 뛰어난 heterojunciton특성과 광전 특성으로 세인의 주목을 받고 있다. 동 시스템의 발전은 소재생장기술 진보에 의존한다. MBE방법은 게르마늄 실리콘 소재 발전과정에서 중요한 역할을 하였으나 생장원가가 높고 대규모적인 생산환경에 적합하지 않는 등 여러 가지 페단이 존재한다. 그 후 IBM에서 개발한 DHV/CVD기술은 산업의 관련 생산요구를 만족시킬 수 있었다.현재 국제상 유수 기업들은 모두 게르마늄 실리콘/실리콘 heterojunciton 소자연구에 대량의 자금과 인력을 투입하였는데 SiGe HBT, GMOSFET, 광 탐색기 등을 속속 연구 제작해냈으며 매우 상당한 수준에 도달하였다. 개별적인 회사들은 이미 양산단계에 들어갔고 게르마늄 실리콘 기술도 실용단계에 진입하였다. 구조가 단일하고 성능이 높으며 유지보수가 편리하며 생사원가가 낮은 등 측성은 산업화 생산에 적합하며 응용과정에서 실리콘 소자 대체품으로 사용 가능하다. 심지어 gallium arsenide소자로 대체 가능하다. 특히 마이크로 웨이브 통신위성, 이동통신위성 및 광 통신 분야에서 매우 큰 시장성이 있을 것으로 예상된다.(1) 동 시스템은 석영강(강)생장실, 흑연보드가열기, 진공외벽(강) 설치실, 고진공세트, 기로시스템, 컴퓨터 컨트롤 및 공정배기가스 처리장치 등으로 구성되었는데 구조가 엄밀하고 조작이 간편하다.(2) 부피가 작은 구형 석영강 생장실은 청결도가 높고 기류가 고르며 청결이 용이한 특성이 있다. 이는 가스 원을 바꾸고 급변하는 소재 인터페이스를 얻는데 큰 이점이 있다. (3) 흑연보드 가열기는 진공외벽에 설치함으로써 생장실에 대한 오염이나 가열과정의 무공해 방사를 피할 수 있고 신속하게 온도를 높이고 내릴 수 있으며 온도분포의 균형을 유지 가능하다.(4) 싱글 칩 외연생장방식을 이용, 마그네틱 전동에 의해 칩을 전송, 생장실 배경 진공도가 높다.(5) 외벽은 석영강 폭발방지 역할을 한다.(6) 생장실, 외벽 칩 설치실은 단독적인 3개 고 진공세트를 사용하며 서로 방해를 주지 않는다.(7) 테스트와 보고서를 통해 청화대학 마이크로 전자학 연구소에서 성공적으로 개발해낸 RHT/HV=CVD외연시스템은 국내외에서 관련 보도를 한 적이 없고 전반적인 구조설계가 합리적이고 혁신성과 선진성을 구비한 것으로 인정되었다.[기술지표](1) 가열온도: 550~1000 (2) 온도 컨트롤 정확도: 3 (3) 최대 가공 칩: 100mm(4) 사용자의 수요에 따라 칩 125mm로 가공 가능.(5) 가공방식: 싱글 칩(6) 기로수량:7개(7) 생장실 배경 진공: < 5uPa(8) 동작전압: 0.01~10 Pa(9) 표준 가스유입량: 10~500cm3/m(10) 외연 생장속도는 조정 가능, 대표적인 값은 1A/S
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- 중국청화대학교
- 등록일
- 2002-12-09
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
본 기술은 반도체 및 초전도체 소자제작에 널리 쓰이는 내화성 금속박막을 잔류응력 없이 스퍼터링하는 기술이다. 박막의 잔류응력은 증착되는 물질분자 또는 클러스터가 갖는 에너지 및 박막형성 시 포함되는 불순물에 영향을 받는다. 스퍼터링 전 진공도가 10E-5 Pa이하일 경우 불순물질의 영향은 무시할 수 있으며, 이때 박막의 잔류응력은 음극 전압, 타겟 침식, 플라즈마 압력 등에 영향을 받으며, 특히 타겟과 기판 사이의 거리가 중요하다. 본 기술의 특징은 타겟과 기판사이의 거리가 5cm 이내일때와 10cm 이상 되는 경우에 잔류응력을 제거시킬 수 있는 공정기술이다. 본 기술은 녹는점이 높은 내화성 금속의 스퍼터링에 유용하게 쓰일 수 있으며, 타겟 침식에 따른 잔류응력 변화에 능동적으로 대처할 수 있어 소사 제조 시 수율을 높일 수 있다.타겟 침식에 따른 잔류응력 변화에 능동적으로 대처할 수 있어 소자제조시 수율을 높일 수 있다.- 반도체 제조 장비 개발 ⇒ PVD 장비 개발, 스퍼터링공정 개발- 반도체 및 초전도소자 제조 ⇒ 금속전극, 배선, 저항 증착- 첨단 센서 제작 ⇒ 열전대 및 박막저항 증착
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- 한국표준과학연구원
- 등록일
- 2003-02-08
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
본 기술은 마이크로 센서소자 제작에 쓰이는 실리콘 습식 식각 기술이다. 100 ㎛ 이상 깊이의 실리콘 식각에 주로 사용하고 있는 습식 식각은 분당 1 ㎛ 이상의 실리콘 식각률을 갖는다. 식각 시간의 조절로 미소하게 설계된 다이아프램, 캔틸레버를 만들 수 있다. N형 실리콘 위에 P형 에피층이 있는 경우 실리콘에 전극을 형성하고 용액 안에 백금전극을 넣어 양단에 바이어스를 걸고 electro-potentiometer로 조절하면 일정한 식각률을 갖는 2 전극 식각 시스템이 된다. 3전극 방식은 2 전극 방식에 기준전극을 추가한 시스템이다. 이 기술의 특징은 실리콘 식각 공정에서 균일한 식각률을 가질 수 있으며 식각 끝점 부근을 알 수 있어 공정 중 과도 식각 등을 예방 할 수 있다.실리콘 식각 공정에서 균일한 식각률을 가질 수 있으며 식각 끝점 부근을 알 수 있어 공정 중 과도 식각 등을 예방 할 수 있다. - 마이크로 센서 개발 ⇒다이아프램, 캔틸레버, 캐비티 형성 - 바이오 칩 개발 ⇒ 채널형성 기술
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- 한국표준과학연구원
- 등록일
- 2003-02-08
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
콤팩트디스크 오디오 응용 분야에 있어서, 작동중인 콤팩트디스크 신호들은 실시간으로 처리되어야 하는데, 이러한 CD 신호들에 대한 특정 하드웨어 구조의 수행능력은 소정의 주파수로 발생하는 샘플들 사이에서 하드웨어가 수행할 수 있는 연산들의 횟수에 의해 측정될 수 있다. 상기 수행능력을 극대화하기 위하여, 많은 디지털 신호 프로세서들은 파이프라인 구조(pipelined architecture) 또는 통합 확장 보조 하드웨어를 이용한다. 그러나 부가되는 하드웨어는 많은 비용을 필요로 하여, 저가 위주의 사용자를 위한 전자 제품에는 쉽사리 사용될 수 없었다. 특히 가전 시장에서는 비용 대비 성능 개선 효과가 우수한 특성을 가진 하드웨어를 구현하는 것이 중요한 관건이다. 본 기술은 위와 같은 문제점들을 해소하기 위한 디지털 신호 처리기를 제공하며, 복수의 어드레스에 데이터를 내장하고 있는 메모리와 연동하도록 되어 있으며, 상기한 메모리와 어드레스 기억부 사이에는 어드레스 버스가 연결되어 있고, 또한 제1 명령 신호를 포함한 프로세싱 명령체계에 의해 작동하도록 되어 있다. 제1 명령신호는 제어 부분과, 적어도 하난의 소스 오퍼랜드 식별자(identifier)로 구성되어 있고, 개개의 소스 오퍼랜드 식별자는 각각 재 기입 비트를 가지고 있다. 이에 따라 제1 명령 신호내의 소스 오퍼랜드 식별자에 의해 메모리내의 제1 어드레스가 결정되면, 그 제1 어드레스내의 데이터가 페치되게 된다. 아울러 상기한 제1 어드레스는, 제1 소스 오퍼랜드 식별자의 재 기입 비트가 활성화될 때, 어드레스 버스를 통해 어드레스 기억부에 기입되도록 되어 있다. 이와 같은 구성에 의해, 메모리에서 페치된 데이터는 일단 프로세스에 의해 처리되어진 후, 제1 소스 오퍼랜드 식별자의 재 기입 비트에 응답하여 상기한 메모리의 제1 어드레스에 다시 기입될 수 있도록 하고 있다.본 기술에 의한 프로세서는 콤팩트디스크 오디오에 응용함에 있어서 하나의 명령에 응답하여 데이터를 이동하되, 다른 명령에 응답하여 동시에 일어나는 계산의 절차 진행에 아무런 영향을 주지 않고 데이터 이동을 수행할 수 있는 특징을 갖는다.
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- (주)테크란
- 등록일
- 2003-03-19
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
승산기 디자인에서 종래의 병렬디자인(예컨대 Wallace tree 승산기)의 경우에는 승산속도 및 비트 수를 증가할 수 있으나 이 경우에는 극적으로 회로 사이즈가 증가하게 된다. 큰 회로 사이즈는 양산 수율을 감소시키고, 단위 신뢰성을 감소시키고, 단위 코스트가 상승하고, 높은 전력소모를 야기하기 때문에 바람직하지 않다. 회로 사이즈는 시리얼 디자인을 통하여 최소화시킬 수 있지만 그럴 경우에는 승산속도가 불리하게 감소되는 문제가 있다. 본 기술은 이와 같은 단점을 해결하기 위한 디지털 승산기로, 각 항신호(Ti, Tj)가 2의 누승이 곱해진 피승수 (T=A*2-i)이거나 제로(T=O*A)의 표시로 만들어질 때, 주어진 피승수 신호 A는 가산 또는 감산 항신호들로 정의될 수 있는 A*P/Q 형태로 승산된다. 맵핑 유닛은 합성시스템이 MN비트 승산기와 동일한 전달함수를 가지도록 배럴(barrel) 시프터에 응답하여 컨트롤하거나 하나 이상의 응답 가산기/감산기 유닛들을 컨트롤하도록 구성되어 있다.본 기술은 피승수 A의 사이즈의 제한이 없으며, N*3 모듈은 면적 능률 구조를 제공하며, N*3 빌딩블록모듈 이내의 기본제어구조이며, 신호전파시간의 감소로 출력산출시간이 감소되는 특징을 갖는다.
- 보유기관
- (주)테크란
- 등록일
- 2003-03-19
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
프로세서의 내부 캐시의 스누프를 최소화시키기 위해 L2 캐시를 포함하는 고급시스템에 한정적으로 사용되어온 방식이 있는데, 이 시스템 하에서는 데이터가 L2캐시에서 캐시되지 않는 한 프로세서의 내부 캐시에서도 캐시되지 않는 문제가 있다. 따라서 외부장치는 L2캐시를 먼저 스누프한 후, L2캐시 히트가 있는 경우에 한하여 비로서 프로세서의 내부 캐시를 스누프 하도록 되어 있다. 그러나 이 방법은 프로세서 외부에 L2캐시를 필요로 한다는 점에서 많은 비용을 필요로 하고 있다. 따라서 내부 캐시 메모리를 가지고 있는 프로세서에서 필요로 하는 스누프 사이클 횟수를 감소시킬 수 있는 대안으로서 비용이 적게드는 방안이 지속적으로 요구되고 있다. 본 기술은 상기한 필요성을 충족시킬 수 있도록 하기 위하여 상기 프로세서 구조에 기인한 트랜잭션을 모니터링하고, 임의의 모니터링 테스트에 따라 상기 제1어드레스 공간의 어드레스 상의 제1 서브셋으로부터의 데이터를 가리키는 각각의 트랜잭션에 응답하여 상기 제1 스누프 자문 셀에 "스누프 예스" 값을 기록하고, 상기 제1어드레스 공간의 어드레스 상의 제1서브셋 내의 어드레스에 대한 추가 장치에 의한 각각의 임의의 억세스에 응답하여, 상기 제1 스누프 자문 셀이 "스누프 예스" 값을 포함하면 상기 임의의 억세스의 주소에 대한 스누프 요청을 상기 프로세서에 발행하고, 상기 제1 스누프 자문 셀이 "스누프 예스" 값을 포함하고 있지 않다면 상기 스누프 요청을 발행함이 없이 상기 메모리 구조를 억세스하며, 다음의 단계 즉, 상기 캐시 메모리에 캐시된 어드레스 상의 상기 제1서브셋의 모든 데이터를 상기 메모리 구조와 일치시키는 단계와, 상기 제1스누프 자문 셀에 "스누프 노" 값을 기록하는 단계를 서로 반복적으로 수행하는 메커니즘을 제공하고 있다.본 기술에서는 스누프 자문 비트들에 대하여 3개의 프로세스를 병렬로 발생시킴으로써 내부 캐시 메모리를 가지고 있는 프로세서에서 필요로 하는 스누프 사이클 횟수를 감소시킬 수 있게 되는 특징이 있다.
- 보유기관
- (주)테크란
- 등록일
- 2003-03-13
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
Looping 방식을 이용한 오디오 신호의 압축시 압축률을 최대로 하고 음질을 보존하는 것과 더불어, 신호 진폭 편차 없이 looping되는 압축된 음성 데이터를 제공할 수 있는 시스템에 대한 필요성이 대두된다.이를 위하여 본 기술은 음성 신호의 16 비트 샘플을 정확한 값과 델타 값 양자로서 압축하기 위한 압축 동작과, 상기 압축된 정확한 값과 델타 값을 다시 한번 16 비트 워드로 재생하기 위한 재생 동작을 포함하여 이루어진다. 그 후, 상기 재생된 정확한 값과 델타 값들은 원래의 샘플과 비교된다. 원래의 샘플과 가장 근접하게 일치하는 재생된 값은 그것이 어느 쪽이든 저장 매체 상에서 인코딩된 해당 압축된 값을 갖도록 되어 있다.본 기술은 어떠한 재생 값에 의해서도, 현재의 샘플과 다음 샘플 양자에 대해 전체적으로 가장 일치된 데이터가 현 샘플의 최적 값으로서 선택될 수 있고, 또한 이 값에 대응하는 압축된 데이터 값이 디스크에 인코딩 되므로 m개의 입력 샘플에 대한 예견이 가능해지는 특징이 있다. 본 기술은 저장 매체 또는 시스템 동적 메모리에 저장되는 데이터의 양을 증가시킬 수 있고, 저장 매체로부터 시스템 동적 메모리로 신호를 더 빠르게 전송하도록 할 수 있는 특징이 있다. 또한 본 기술은 현재의 샘플링 디지털 음성 신호를 제1 압축 디지털 값으로 압축하고, 이전의 샘플링 디지털 음성 신호에 대한 현재의 샘플링 디지털 음성 신호의 변화를 제2 압축 디지털 값으로 압축한 후, 실제의 샘플 디지털 오디오 신호에 대한 비교를 통하여 제1 및 제2 압축 디지털 값을 재생함으로써 Encoding된 음성 신호에 대해 최적의 음질을 얻어낼 수 있는 특징이 있다.
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- (주)테크란
- 등록일
- 2003-03-13
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
MPEG 출력은 양자화 충실도가 낮은데, 이는 MPEG이 가지는 "dead space" 때문이다. 또한 양자화 에러는 디지털 신호의 양자화 범위가 작을 수록 증가하는 경향이 있다. 이는 MPEG 출력 시그널이 라인당 352 비장방형 픽셀을 가지는 경우에도 발생하는 결함이며, "blocking" 및 "banding" 과 같은 압축 해제와 디지털화 기술에서도 발생하는 문제이다. 따라서 높은 충실도를 가지는 양자화 및 디지털라이징 기술이 요청되고 있는 상황이다. 본 기술은 상기와 같은 요구에 부응하기 위하여 압축된 FMV(Full Motion Video)를 실시간(real time)으로 압축 해제하는 기술을 제공한다.본 기술에서 압축 해제된 플레이백(재생) 신호는 후압축해제(post-decompressed) 처리를 위한 어댑터를 통해 실시간 비디오 프로세싱 시스템에 전달되며, 상기 후압축해제 처리는 실시간(real time), 상호 지오메트리 변환(interactive geometry transformations), 컬러 리맵핑(color re-mappings)을 포함하며, 상기 어댑터는 CCIR-601에서 발견되는 것과 같은 `dead space`를 제거하기 위한 영역 확장 모듈(range expansion module)을 포함하여 구성된다. 또한 상기 어댑터는 압축 해제된 플레이백 시그널의 라인당 픽셀 포맷을 프로그램을 통해 변경하는 수단이 되는 리샘플링 모듈을 구비하며, 상기 어댑터는 클립 앤 디서 모듈(clip-and-dither module)을 더 구비하는데, 이는 어댑터 출력 시그널의 픽셀당 비트수의 포맷을 변경하고 어댑터 출력 시그널에 프로그램상 정의된 디서(dither)를 적용하기 위함이다.본 기술은 I압축된 FMV(Full Motion Video) 신호를 실시간으로 압축해제 처리하기 위한 기술로 압축된 비디오 신호를 복원한 후에 geometry transform, color remapping, range expansion, resampling, clipping-and-dithering 등의 부가 기능을 실시간으로 처리하는데에 특징이 있으며, FMV를 넓은 범위에 걸친 고충실도(high fidelity), 실시간, 후압축 해제, 디지털 처리가 가능하게 하는 MPEG 압축해제 출력을 채용하는 방법과 장치를 제공할 수 있는 장점이 있다.
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- (주)테크란
- 등록일
- 2003-03-13
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
본 기술은 프로그램 가능한 영상 디코딩 장치를 이용하여, 시스템 메모리에 저장된 MPEG 인코딩된 영상 데이터를 디코딩하기 위한 방법에 관한 것이다. 본 기술에서는 MPEG 인코딩된 영상 데이터로부터 영상 데이터와 동작 보상 데이터를 포함하는 매크로블록의 정보를 추출하는 단계와, MPEG 인코딩된 데이터를 디코딩하기 위해 상기 MPEG 인코딩된 영상 데이터로부터 일련의 매개 변수를 추출하는 단계와, 상기 인코딩된 영상 데이터로부터 양자화 계수들을 결정하는 단계와, 상기 인코딩된 데이터를 디코딩하기 위한 매개 변수들을 가지고 상기 매크로블록 데이터를 동작 벡터와 상기 일련의 매개 변수를 가지고 있는 영상 데이터로 파싱하기 위한 수단과 역 양자화를 수행하는 수단으로 이루어진, 프로그램 가능한 영상 디코딩 장치를 구성하는 단계와, 상기 추출된 매크로블록 정보의 디코딩 순서를 결정하는 단계와, 상기 추출된 매크로블록 정보를 디코딩 순서로 상기 파싱 수단으로 제공하는 단계와, 상기 디코딩 영상 데이터를 상기 파싱 수단에 의해 추출된 동작 벡터와 결합하는 단계와, 상기 결합된 데이터를 시스템 메모리에 저장하는 단계를 포함하여 이루어진다.본 기술은 시스템 메모리에 저장된 MPEG 인코딩된 영상 데이터를 디코딩하기 위한 방법을 제공함으로써, 다른 MPEG 스트림이 동시에 코딩될 것을 요구하는 양방향성 응용들을 구현할 수 있는 특징이 있다.
- 보유기관
- (주)테크란
- 등록일
- 2003-03-13
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
본 기술은 ISO/IEC 국제표준 11172-2에 따라 인코딩된 동영상 데이터를 추출하고 디코딩하기 위한 시스템에 관한 것이다.본 기술은 MPEG 인코딩된 데이터의 제1 부분을 디코딩하기 위한 소프트웨어 명령들을 포함하는 MPEG 디코딩 시스템을 제공하는데, 상기 소프트웨어 명령은 MPEG 인코딩된 데이터로부터 매크로블록 데이터를 추출하여 상기 매크로블록 데이터에 대한 디코딩 순서를 설정하기 위한 명령을 포함한다. 이 시스템은 상기 매크로블록으로부터 동작 벡터 및 디스플레이 데이터를 추출하기 위한 하드웨어를 더 구비한다. 엔트로피 디코더는 상기 디스플레이 데이터에서 인코딩된 AC 계수들과 DC 계수들을 디코딩 한다. 역 양자화 장치는 상기 계수들을 디코딩된 AC 계수들의 결과적인 어레이로 역 양자화한다. 디-지그재그(de-zig-zag) 장치는 디코딩된 AC 계수들과 DC 계수들의 상기 어레이를 지그재그 형태로 검색하여 이산 코사인 변환된 계수들의 블록을 제공한다. 역 이산 코사인 변환 장치는 이산 코사인 변환된 계수들의 상기 블록에 대해 역 이산 코사인 변환을 취하여 제1 픽셀 데이터 세트를 제공한다. 동작 벡터 프로세서는 동작 벡터 데이터를 디코딩 하여 제2 픽셀 데이터 세트를 제공하며, 동작 보상 장치는 상기 제1 및 제2 픽셀 데이터 세트를 더하도록 구성되어 있다.본 기술에 의하면, MPEG 디코딩 스트림을 효과적으로 처리하기 위하여 디코딩 프로세서의 시스템 자원과 관련하여 호스트 시스템으로부터의 시스템 자원을 이용하는 MPEG 디코딩 시스템이 제공된다.다중 시퀀스 MPEG 디코더에 관한 MPEG1, MPEG2급 기술로서 Decoding Processor와 Host System의 System Resource를 사용하여 효과적인 MPEG Decoding Sequence를 구현하는데 특징이 있다. 본 기술은 MPEG 디코딩 스트림을 효과적으로 처리하기 위하여 디코딩 프로세서의 시스템 자원과 관련하여 호스트 시스템으로부터의 시스템 자원을 이용하는 MPEG 디코딩 시스템을 구현함으로써, 최소한의 호스트 시스템과 처리 하드웨어 자원을 이용하여 고 대역폭을 획득할 수 있고 저가의 디코딩 시스템을 제공할 수 있는 장점이 있다. 본 기술에 따른 MPEG 디코딩 시스템은 자원들을 호스트 시스템 주 메모리와 중앙처리장치를 포함하는 호스트 시스템과 공유하며, 또한, 멀티미디어 주문형 반도체의 일부분으로써 MPEG 디코더를 구체화할 수 있다.
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- 2003-03-19
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전기·전자 > 집적회로설계 기술 (B63)
본 기술은 디지털 이미지의 차동 펄스 코드 변조(DPCM : Differential Pulse Code Modulation) 시스템에서 Y 화소 어레이의 압축 해제 시간을 감소시키기 위한 것이다.본 기술에서는 디지털 이미지 DPCM 시스템의 압축해제기가 그의 구동 사이클 동안 화소 어레이의 대각선 방향으로 놓인 다수의 선택 화소들에 대한 압축 해제값을 동시에 생성하기 위하여 제공된다. 스토리지는 그 압축 해제기의 구동 사이클 동안 처리될 각 선택 화소에 대한 에러값을 저장한다. 프로세서는 압축 해제된 값이 각 선택된 화소에 대한 에러값으로부터 유도되는 각 선택 화소에 대한 압축 해제값과, 각 선택된 화소를 위하여 상기 프로세서에 의하여 발생된 예측값을 동시에 생성한다. 예측값은 적어도 2차, 즉 2차원의 예측기로부터 유도된다. 디지털 이미지 DPCM 시스템의 압축기는 그의 구동 사이클 동안 다수의 선택된 화소들의 각각에 대한 압축 해제값과, 부호화되고 양자화된 에러값을 동시에 생성하기 위하여 제공된다. 다수의 선택된 화소들은 상기 부호화되고 양자화된 에러값들이 상기 화소 어레이에 의하여 표현되는 이미지를 발생시키는데 사용될 화소 어레이의 대각선상에 위치한다.본 기술은 디지털 이미지의 압축 및 압축 해제를 위한 DPCM 시스템에서 다수의 화소들에 대한 압축 해제된 값들을 동시에 생성하여 모든 Y화소 어레이를 압축 해제하는데 필요한 시간을 감소시킴으로써 압축된 이미지의 압축해제시간을 감소시키는 효과를 제공하는 특징이 있다.
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- 2003-03-13
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전기·전자 > 집적회로설계 기술 (B63)
본 기술은 다중 위상 필터/디지털-아날로그 변환기의 앨리어스 노이즈 곱 에너지를 현저히 감쇄시키기 위한 것이다.본 기술은 M개(M≥2)의 디지털 필터를 포함하여 구성되는데, 각 디지털 필터는 입력 표본 추출 주파수 Fs를 가지고 있는 샘플링된 입력신호를 수신하며, m번째 필터는 각각 전달 특성 hm[n]을 지니고 있으며, 입력 표본 추출 속도 Fs에서 갱신된 각각의 출력 신호를 생성하며, m번째 필터는 입력 표본 추출 클록의 각 m번째 위상에 응답하여 출력신호를 갱신하도록 구성된다. 또한 본 기술은 디지털 필터의 출력 신호들을 조합하여 적어도 MFs의 표본 추출 속도를 지닌 조합된 출력 신호를 생성하는 수단을 포함하여 구성된다. 출력 필터들을 조합하기 위한 수단은 선형 조합만을 수행하거나, Overflow 및 Underflow Clamping과 같은 다른 기능을 선택적으로 포함할 수 있도록 구성되어 있다.두 배의 정상 주파수(2Fs)에서 동작하는 단일 DAC 또는 정상 주파수(Fs)에서 각각 동작하는 두 개의 DAC를 사용하여 아날로그 신호에 대한 그룹 지연 왜곡 효과를 감소시키고, 보간되지 않은 데이터 표본 추출 속도 Fs에서 앨리어스 노이즈 곱 에너지를 현저하게 감쇄할 수 있는 특징이 있다.
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- 2003-03-13
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전기·전자 > 집적회로설계 기술 (B63)
본 기술은 가파른 주파수 영역 롤오프 특성을 가지는 한편, 정상상태에 의해 정해지는 컴플라이언스 영역을 위반하지 아니하는 디지털 필터를 구현하기 위한 기술을 제공한다.본 기술에 의한 디지털 필터 전달함수는 적어도 두 개의 구현 필터, 즉 미리 정하여진 출력 컴플라이언스(compliance) 범위 내에서 무제한적인 출력을 보장하는 전달함수를 지닌 필터와, 전체적으로 요구되는 전달함수와 첫 번 째 구현 필터의 전달함수 간의 차이에 해당하는 전달함수를 지닌 필터를 이용하여 구현되며, 이 두개의 구현 필터에 의해 생성된 출력 샘플은 합쳐져서 전체 출력 샘플을 생성한다. 그러나, 만일 상기 구현 필터 중 하나로부터의 출력샘플과 다른 하나의 구현 필터로부터의 해당 출력샘플의 합이 소정의 문턱 값 이상 또는 이하로 떨어지면, 첫 번 째 구현된 필터의 출력은 상기 합쳐진 출력 대신에 전체 필터의 샘플출력으로 생성된다. 따라서, 필터의 응답이 컴플라이언스 범위 위반을 피할 필요가 있을 때에만 저하되는 반면, 과도한 언더슈트 및 오버슈트가 방지된다.본 기술에서는 두개 이상의 구현 필터를 이용하여 전체적으로 원하는 필터 특성을 구현하고 구현필터에 의해 생성된 출력 샘플의 합의 순간 진폭에 응답하여 구현 필터의 출력샘플들 중 하나 또는 그들의 합을 선택한다는 구상은 과도한 언더슈트/오버슈트 문제를 야기하지 않기 때문에 많은 디지털 필터 응용분야에서 이용될 수 있는 특징이 있다.
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- 2003-03-19
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전기·전자 > 집적회로설계 기술 (B63)
본 기술은 비디오 엔코더 전단에서 처리해야하는 감마 보정을 구현하기 위한 것으로, 아날로그와 디지털 2가지 감마 보정 방법의 문제점, 즉 부정확하고 이미지 소스를 디지털로 처리하는데 그 자체를 이용할 수 없는 아날로그의 단점과 픽셀 수가 적은 경우에는 상대적으로 너무 큰 ROM을 사용하게 되어 비효율적인 디지털의 단점을 개선한 기술이다.본 기술에서는 1) 상당히 감소된 칩 영역을 이용하여 감마 보정을 수행하고, 2) 룩업 테이블을 이용하지 않고 알고리듬 적으로 감마 보정을 수행하고, 3) 승 변환으로 입력 값을 나타내는 신호를 출력 값을 나타내는 신호로 변환하는 것과, 4) 칩 영역을 상당히 줄이는 하드웨어 회로를 이용하여 몇 가지 형태의 수학적 기능을 계산하는 것과, 5) 몇 가지 형태의 수학적 기능을 계산하는 매우 효율적인 방법을 제공하여 감마 보정을 한다.Video Encoder 전단에서 처리해야 하는 gamma correction 회로를 전체를 piecewise로 나눈 후 각각에 대한 다른 처리 방식, 즉 look-up table을 이용하는 gamma correction에 있어서 table은 하나의 구간에 대한 것만 준비해 두고 다른 구간들에 대해서는 scaling에 의해서 correction 하는 방법(제일 작은 구간은 linear correction함)으로 구현함으로써 감마 수정에 있어서 하드웨어에서 칩 영역을 대폭 줄임으로써 제조단가를 낮출 수 있는 특징이 있다.
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- 2003-03-13
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전기·전자 > 집적회로설계 기술 (B63)
본 기술은 지오메트리(geometry) 처리와 렌더링(rendering)으로 대별되는 3D 컴퓨터 그래픽 처리 중에서 렌더링에 적용되는 z-버퍼(z-buffer)의 Hidden line/surface 제거에 관한 기술이다. 본 기술에 의한 그래픽 시스템은 정점에 근거한 연기된 지시들로부터 유도된 이미지 데이터를 표시할 수 있는 프레임-버퍼로의 실시간 렌더링을 위한 삼각-엔진을 포함하며, 이 시스템은 텍스트 맵핑용 뿐만 아니라 z-버퍼와 같은 폐색 맵핑용 균일도 값들(1/w 값들)을 이용하고, (1/w), (u/w) 및 (v/w) 값들을 블록-고정된 포맷으로 표시함으로써 폐색 맵핑 및 텍스쳐 맵핑 양자에 대하여 깊이 해상도가 향상된다.본 기술의 그래픽 시스템은 폐색 맵핑 및 텍스쳐 맵핑 양자에 대하여 깊이 해상도를 향상시키며, 또한 리스트에 기초하여 메모리 서브시스템으로부터 콤팩트 렌더-제어 리스트들과 소스 이미지 데이터를 주기적으로 인출하므로써 시스템 메모리와 시스템 CPU의 메모리에 대한 부하를 감소시키는 특징이 있다.
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- 2003-03-19
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
본 기술은 시각적 이미지의 표시가 아날로그 포맷으로부터 디지털 포맷으로 변화됨에 따라 이미지 데이터의 디지털 처리와 그러한 이미지 데이터의 표시에서 대두되는 문제를 해결하기 위한 기술로서, 실시간으로 렌더링 엔진을 제어하여 사물을 입체적인 형태로 용이하게 구현하도록 한 것이다. 본 기술은 리스트에 기초하여 메모리 서브시스템으로부터 콤팩트 렌더-제어 리스트들과 소스 이미지 데이터를 주기적으로 인출함으로써 시스템 메모리와 시스템 CPU의 메모리에 대한 부하를 감소시켜, 그래픽 시스템의 다른 시간-임계 작업들을 다루기 위한 시스템 CPU(또는 CPU`s)를 자유롭게 한다.본 기술은 이미지-렌더링 제어 리스트들을 저장하는 다중 포트 메모리 서브시스템을 가지며, 실시간 프로그램 가능하게 구성된 렌더-엔진을 부가적으로 갖는 그래픽 시스템을 제공함으로써, 시스템 메모리 액세스를 위한 복수의 잠재적 요구자들 간의 경쟁을 줄일 수 있고, 시스템 CPU의 제한된 리소스들로의 액세스를 위한 복수의 소프트웨어 모듈에 의한 경쟁을 줄일 수 있다. 아울러 실시간 비디오 디스플레이 서브시스템 처리 및 실시간 애니매이션 서브시스템의 처리와 같은 다수의 시간-임계 처리의 필요성을 동시에 만족시키는 등 다양한 효과를 나타낸다. 뿐만이나라 불법 소프트웨어나 하드웨어 모듈이 시스템 임계 레지스터나 기억 장소에의 비의도적인 서입(write)에 의하여 모든 시스템을 다운시킬 가능성을 감소시키는 특징이 있다.
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- 등록일
- 2003-03-13
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일반기술
전기·전자 > 집적회로설계 기술 (B63)
본 기술은 복잡하고 생동감 있는 장면의 사실적 렌디션을 위한 저가의 시스템과 컴팩트한 이미지 렌더링 시스템을 저가로 제공하고자 한 기술이다. 본 기술은 메모리에 해당 서브 이미지를 위한 렌더링 정보를 전송하는 제어 블록들의 연결 리스트를 준비하는 단계, 하나의 값을 추가 이미지부의 상기 메모리에 있는 베이스 주소를 나타내는 제 1 제어 레지스터(REGCTL2)에 기록하는 단계, 하나의 값을 상기 목적지 버퍼의 상기 메모리에 있는 베이스 주소를 나타내는 제 2 제어 레지스터(REGCTL3)에 기록하는 단계 및 그래픽 조작 처리기로 하여금 서브 이미지들을 상기 제 2 제어 레지스터(REGCTL3), 상기 연결 리스트 안의 상기 제어 블록들의 일련의 이미지에 반응 및 상기 제 1 제어 레지스터(REGCTL2)의 값에 의해 동일시된 상기 추가 이미지 부분의 조합의 값에 의해 동일시된 목적지 버퍼로 렌더링시키는 단계를 포함하는 렌더링 시스템을 제공한다.본 기술은 Linked list 형식으로 Spryte control block을 메모리에 생성한 후 전용 하드웨어 장치를 기동하여 하드웨어 렌더링 엔진이 spryte를 CPU와는 독립적으로 렌더링 가능하도록 하는 방법을 구현함으로써 동적 장면의 사실적인 렌디션을 제공하는 시스템을 저가로 제공할 수 있는 특징이 있다.
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- (주)테크란
- 등록일
- 2003-03-13
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